元件布局基本规则
1．按电路模块进行布局，实现同一功能的相关电路称为一个模块，电路模块中的元件应采用就近集中原则，同时数字电路和模拟电路分开；
2．定位孔、标准孔等非安装孔周围1.27mm内不得贴装元、器件，螺钉等安装孔周围3.5mm（对于M2.5）、4mm（对于M3）内不得贴装元器件；
3．卧装电阻、功率电感（插件）、电解电容等元件的下方避免布过孔，以免波峰焊后过孔与元件壳体短路；
4．元器件的外侧距板边的距离为5mm；
5．贴装元件焊盘的外侧与相邻插装元件的外侧距离大于2mm；
6．金属壳体元器件和金属件（屏蔽盒等）不能与其它元器件相碰，不能紧贴印制线、焊盘，其间距应大于2mm。定位孔、紧固件安装孔、椭圆孔及板中其它方孔外侧距板边的尺寸大于3mm； 25微米的孔壁铜厚 好处：增强可靠性，包括改进z轴的耐膨胀能力。佛山电源PCB板
常见阻抗匹配的方式
(1)串联终端匹配在信号源端阻抗低于传输线特征阻抗的条件下，在信号的源端和传输线之间串接一个电阻R，使源端的输出阻抗与传输线的特征阻抗相匹配，抑制从负载端反射回来的信号发生再次反射。匹配电阻选择原则：匹配电阻值与驱动器的输出阻抗之和等于传输线的特征阻抗。常见的CMOS和TTL驱动器，其输出阻抗会随信号的电平大小变化而变化。
因此，对TTL或CMOS电路来说，不可能有十分正确的匹配电阻，只能折中考虑。链状拓扑结构的信号网路不适合使用串联终端匹配，所有的负载必须接到传输线的末端。串联匹配是极常用的终端匹配方法。它的优点是功耗小，不会给驱动器带来额外的直流负载，也不会在信号和地之间引入额外的阻抗，而且只需要一个电阻元件。常见应用：一般的CMOS、TTL电路的阻抗匹配。USB信号也采取这种方法做阻抗匹配。 深圳电源PCB打样沉金是在裸铜上包裹一层电气性能良好的镍金合金，是需要覆盖镍和金的合金。
一般内层处理的黑氧化方法：
棕氧化法
黑氧化处理
低温黑化法
采用高温黑化法内层板会产生高温应力（thermal stress）可能会导致层压后的层间分离或内层铜箔的裂痕；
二、棕氧化：
黑氧化处理的产物主要是氧化铜，没有所谓的氧化亚铜，这是业内的一些错误论调，经过ESCA（electro specific chemical analysis）分析，可以测定铜原子和氧原子之间的结合能，氧化物表面铜原子和氧原子之间的比例；有清晰数据和观察分析证明黑化的产物就是氧化铜，没有其他成分。
黑化的一般组成：
氧化剂、亚氯酸钠、氢氧化钠、PH缓冲剂、磷酸三钠、表面活性剂或碱式碳酸铜的氨水溶液（25%氨水）。
单、双层板通常使用在低于10KHz的低频模拟设计中:
1）在同一层的电源走线以辐射状走线，并极小化线的长度总和；
2）走电源、地线时，相互靠近；在关键信号线边上布一条地线，这条地线应尽量靠近信号线。这样就形成了较小的回路面积，减小差模辐射对外界干扰的敏感度。当信号线的旁边加一条地线后，就形成了一个面积极小的回路，信号电流肯定会取道这个回路，而不是其它地线路径。
3）如果是双层线路板，可以在线路板的另一面，紧靠近信号线的下面，沿着信号线布一条地线，前线尽量宽些。这样形成的回路面积等于线路板的厚度乘以信号线的长度。 大批量生产时，在2.54毫米标准坐标网格交点上的两个盘之间布设一根导线，导线宽度大于0.3毫米。
1、输入端的过孔应防止在电容前，输出端过孔应放置电容后，GND的过孔就近摆放。
2、电源对于高速板，需要考虑PI的问题，就是电源完整性的问题，这个做仿真可以测出来。
3、电源完整性，对于高速板，对层叠也要有一定的要求，可以按照前人的经验套模版，或者是用SI9000算阻抗，自己设计层叠，然后与板厂进行沟通，得到合理的结果。4、对于电源层的分割，分割都是板子的中心电源。什么是中心电源，就是一些电源电流大，数量多的那种。一个平面，至多不能超过分割3个电源。需要考虑的是，分割不能够出现载流瓶颈。
5、当存在数字地和模拟地的时候，需要分别的进行铺铜处理，常用是使用零欧姆的电阻或者是磁珠进行跨接，并且打上适量的过孔，不能对其他信号有干扰。
6、在层叠设置的时候，需要满足20H的原则，就是电源平面比地平面內缩20mil，如果板子足够大，可以30-50mil进行调整。并且在內缩的部分打上适量的地过孔。（100-150mil的等间距） 线路板要考虑接插安装电子元件，后期的SMT接插需要导电性能和信号传输性能，所以就会要求阻抗越低越好。广州多层PCB推荐厂家
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